電源完整性如何進(jìn)行測(cè)試驗(yàn)證?/成品PCB的外形公差,層間位移公差各是多少?

2016-11-07  by:CAE仿真在線  來(lái)源:互聯(lián)網(wǎng)


轉(zhuǎn):微信群"SI-list 中國(guó)【1】"聊天記錄:

————— 2015-12-10 —————

若華 上午7:57
請(qǐng)問(wèn)下電源完整性如何進(jìn)行測(cè)試驗(yàn)證

李黎明 上午7:59
@蔣方 ?好問(wèn)題!

荊棘鳥(niǎo) 上午7:59
量壓降?

荊棘鳥(niǎo) 上午8:00
負(fù)載電壓波動(dòng)?

若華 上午8:01
很多東西仿真可以做。但是覺(jué)得為什么要這么做 效果如何呢? 好像PI不像Si那么好測(cè)試驗(yàn)證吧?請(qǐng)教各位有經(jīng)驗(yàn)的大師

李黎明 上午8:03
平面層阻抗很低,測(cè)試同軸一般50,這可是業(yè)界難題.

楊雪冬 上午8:05
@李黎明(Shark4685)?直接用示波器不行嗎?

楊安毅 上午8:05
請(qǐng)教一個(gè)問(wèn)題,仿出來(lái)目標(biāo)阻抗怎么用測(cè)試驗(yàn)證?

楊安毅 上午8:06
如果測(cè)試無(wú)法驗(yàn)證,仿真結(jié)果怎么衡量準(zhǔn)確性

李黎明 上午8:07
需要寬頻s參數(shù)

李黎明 上午8:09
還有它是動(dòng)態(tài)的

若華 上午8:10
@李黎明(Shark4685)?平面層阻抗怎么測(cè)

若華 上午8:11
目標(biāo)阻抗只是假想的一個(gè)理想指吧 ?

李黎明 上午8:13
keysight有個(gè)專(zhuān)門(mén)儀器

李黎明 上午8:13
zte國(guó)內(nèi)這個(gè)有些發(fā)言權(quán)

若華 上午8:14
儀器名字是什么 我 查查看 謝謝

李黎明 上午8:16
等我啃完這個(gè)餅

若華 上午8:16
[呲牙][呲牙] 多謝多謝李總

qzheng 上午8:18
5062

若華 上午8:19
除了這些電源完整性還利用什么儀器測(cè)試驗(yàn)證哪些參數(shù)嗎?

若華 上午8:19
謝謝

周振東 上午8:21
tek的DSA8300也可以測(cè)

周振東 上午8:23
還需要測(cè)串?dāng)_吧

干柴 上午8:25
這個(gè)群真好,一大早就技術(shù)大研討,專(zhuān)家們邊啃餅邊交流[呲牙]

李黎明 上午8:26
電源完整性如何進(jìn)行測(cè)試驗(yàn)證?/成品PCB的外形公差,層間位移公差各是多少?HFSS培訓(xùn)課程圖片1

周振東 上午8:27
[強(qiáng)]

曲國(guó)遠(yuǎn) 上午8:27
測(cè)平面和測(cè)信號(hào)的網(wǎng)分不一樣嗎?

李黎明 上午8:27
不一樣

楊安毅 上午8:28
8300應(yīng)該測(cè)不了吧,精度達(dá)不到

偉~笑向暖@ 上午8:30
pi測(cè)試驗(yàn)證是比較難的吧?@李黎明(Shark4685)

李黎明 上午8:33
@遲大偉?我個(gè)人感覺(jué),要對(duì)pi有一定的理解,認(rèn)知才好動(dòng)手.測(cè)只是最后一環(huán)

李黎明 上午8:34
群2的牛人,用示波器點(diǎn)下電源,看下頻譜就定位問(wèn)題了![衰]

楊安毅 上午8:37
最終還是需要測(cè)試!

若華 上午8:39
舉個(gè)例子 對(duì)某個(gè)芯片的去耦電容仿真優(yōu)化如何測(cè)試和驗(yàn)證這樣做的效果

瘋子 上午8:41
@李黎明(Shark4685) 怎么做到的

荊棘鳥(niǎo) 上午8:44
@李黎明(Shark4685)?負(fù)載和頻譜什么關(guān)系?

李黎明 上午8:45
人家對(duì)自己設(shè)計(jì)單位東西很了解.

李黎明 上午9:03
我們有個(gè)客戶,電容都邊測(cè)試邊焊接的!

瘋子 上午9:05
什么產(chǎn)品啊,要求這么高

黃躍輝 上午9:05
電容邊測(cè)試邊焊接[強(qiáng)]敬業(yè)!

于爭(zhēng) 上午9:06
PDN阻抗,用失網(wǎng),雙端口測(cè)如果板上只有電容,仿測(cè)擬合非常好

瘋子 上午9:09
有什么好用的云操作系統(tǒng)沒(méi)

李黎明 上午9:42
@楊雪冬-西安電子工程研究所?楊主任,外形尺寸一般公差+-5mil,要求高的+-2mil,@于爭(zhēng)?層間位移同一張core+-2mil,不同的core,8層以上+-8mil.

紅塵天使 上午9:42
對(duì)于ddr2.-4片和一片ecc星形結(jié)構(gòu),有好的處理方式嗎?

紅塵天使 上午9:42
仿真結(jié)果

紅塵天使 上午9:42
對(duì)于ddr2.-4片和一片ecc星形結(jié)構(gòu),有好的處理方式嗎?

紅塵天使 上午9:42
仿真結(jié)果

紅塵天使 上午9:43
電源完整性如何進(jìn)行測(cè)試驗(yàn)證?/成品PCB的外形公差,層間位移公差各是多少?HFSS培訓(xùn)課程圖片2

紅塵天使 上午9:43
拓?fù)浣Y(jié)構(gòu)

紅塵天使 上午9:43
電源完整性如何進(jìn)行測(cè)試驗(yàn)證?/成品PCB的外形公差,層間位移公差各是多少?ansys hfss圖片3

李黎明 上午9:51
sorry[壞笑]

李黎明 上午9:55
上面是極限值,一般會(huì)比這個(gè)好!

李黎明 上午9:56
@紅塵天使?ecc放通道第一顆,正反貼,數(shù)據(jù)走t拓?fù)浣Y(jié)構(gòu)

丹東 上午9:59
@瘋子?我有個(gè)朋友是做云系統(tǒng)的,有需要可以聯(lián)系。

楊雪冬 上午10:05
@李黎明(Shark4685)?公差幫我查了嗎?

汪進(jìn)進(jìn)_鼎陽(yáng)科技 上午10:07
[FFT之于頻譜分析儀 : http://mp.weixin.qq.com/s?__biz=MjM5Nzc1NzM0NQ==&mid=401798147&idx=1&sn=06a8970a6d7e2b3ff287deab5e97fe74&scene=1&srcid=12102yOFYaosRv8QxbYq90Qh#rd]

李黎明 上午10:09
@楊雪冬-西安電子工程研究所?楊主任,外形尺寸一般公差+-5mil,要求高的+-2mil,@于爭(zhēng)?層間位移同一張core+-2mil,不同的core,8層以上+-8mil.

楊雪冬 上午10:11
@李黎明(Shark4685)?收到,多謝

紅塵天使 上午10:15
電源完整性如何進(jìn)行測(cè)試驗(yàn)證?/成品PCB的外形公差,層間位移公差各是多少?ansys hfss圖片4

紅塵天使 上午10:15
是這樣放置的

瘋子 上午10:20
@丹東 謝謝

藍(lán)風(fēng) 上午10:49
層間位移,8層以上+-8mil [驚訝]

朱江 上午10:58
大廠不至于

邵鵬 上午11:01
我估計(jì)@李黎明(Shark4685)?謙虛了,說(shuō)的是最壞情況吧,但是5mil是很常見(jiàn)的。經(jīng)特殊控制也要2mil。

藍(lán)風(fēng) 上午11:01
是呀,嚇了我一跳,對(duì)位就8mil偏差,加上孔位孔徑偏差,就太大了

藍(lán)風(fēng) 上午11:01
我也覺(jué)得@李黎明(Shark4685) 口誤了

藍(lán)風(fēng) 上午11:02
5mil應(yīng)該都是包含了孔位孔徑偏差在里面,要不然孔壁到線的距離就不夠了

李黎明 上午11:20
正常8層,3core,5-6mil左右,上面是極限值,一般會(huì)好!



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